MIPS处理器列表

主条目：MIPS架构处理器
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这是一个基于MIPS指令集架构的列表，其中包括推出年份、制程大小、频率、裸晶尺寸等基本信息。这些处理器是被 Imagination Technologies、MIPS科技公司、Wave Computing、龙芯中科、北京君正等其他公司设计出来。这个列表显示了MIPS处理器的基本信息，包括这些处理器在性能，功能和功能上与最新的MIPS Aptiv系列的对比。

MIPS计算系统/MIPS科技公司

MIPS版本 处理器 推出年份 制程
（nm） 		频率
（MHz） 		晶体管
（百万） 		裸晶面积 （mm²） 针脚数 功耗(W) 电压(V) 缓存（KiB） 特性
一级（单核） 二级 三级
数据 指令
MIPS I R2000 1985 2000 8 to 16.67 0.11 80 64 external 64 external none none 5 stage pipelines, FPU: 2010;
R3000 1988 1200 20 to 40 0,11 40 145 4 32 32 1 MB external none same as R2000; FPU: 3010;Sony PlayStation
MIPS II R6000 1990 60 to 66 external external none none 32-bit register size, 36-bit physical address, FPU; A 32 bit ECL microprocessor manufactured by a company called Bipolar Integrated Technology (BIT). Production problems with the chip almost killed MIPS Computers and led to it being taken over by SGI. The CMOS R4000 followed hot on the R6000's heels and was cheaper, cooler, and higher performance as well as being 64 bit so the 6000 quickly become a minor footnote in RISC computing history.
MIPS III R4000 1991 800 100 1.35 213 179 15 5 8 8 none
R4400 1992 600 100 to 250 2.3 186 179 15 5 8 8 none
R4200 1993 600 80 1.3 81 179 1.8-2.0 3.3 8 16 128 KB to 4 MB external none scalar design with a five-stage classic RISC pipeline
R4300i 1995 350 100 / 133 45 120 2.2 3.3 none
R4600 1994 640 100 / 133 2.2 77 179 4.6 5 16 16 512 KB external none
R4650 1994 640 133 / 180 2.2 77 179 4.6 5 16 16 512 KB external none
R4640 1995 640 179 none
R4700 1996 500 100 to 200 2.2 179 16 16 External none
MIPS IV R5000 1996 350 150 to 200 3.7 84 223 10 3.3 32 32 1 MB external none
RM7000 1998 250, 180, 130 250 to 600 18 91 304 10, 6, 3 3.3, 2.5, 1.5 16 16 256 KB internal 1 MB external
R8000 1994 700 75 to 90 2.6 299 591 30 3.3 16 16 4 MB external none superscalar, up to 4 instructions per cycle
R10000 1996 350, 250 150 to 250 6.7 350 599 30 3.3 32 32 512 KB – 16 MB external none
R12000 1998 350, 250 270 to 360 7.15 229 600 20 4 32 32 512 KB – 16 MB external none single-chip 4-issue superscalar
R12000A 2000 180 400 none
R14000 2001 130 500 7.2 204 527 17 32 32 512 KB – 16 MB external none
R14000A 2002 130 600 17 32 32 none
R16000 2003 110 700 to 1000 20 64 64 512 KB – 16 MB external none
R16000A 2004 110 800 to 1000 64 64 none
R18000 2001 130 1.2 1 MB none was planned, but not manufactured
MIPS V H1 "Beast" none was planned, but not manufactured
H2 "Captain" none was planned, but not manufactured
MIPS32 4K 1999 180 167 2.5 none
4KE 90 420 1.2 none
24K 2003 130, 65, 40 400 (130 nm) 750 (65 nm) 1468 (40 nm) 0.83 0 to 64 0 to 64 4–16 MB external none
24KE 2003 130, 65, 40 none The MIPS32 24KE Core Family: High-Performance RISC Cores with DSP Enhancements
34K 2006 90, 65, 40 500 (90 nm) 1454 (40 nm) none
74K 2007 65 1110 2.5 0 to 64 0 to 64 none
1004K 2008 65 1100 4.7 8 to 64 8 to 64 none
1074K 2010 40 1500 none
1074Kf 2010 40 none Floating point
microAptiv 2012 90, 65 8 to 64 8 to 64 none
interAptiv 2012 4 to 64 4 to 64 up to 8 MB internal none
proAptiv 2012 32 or 64 32 or 64 up to 8 MB internal none
MIPS64 5K 1999
20K 2000

Imagination Technologies

MIPS Technologies was acquired 17 December 2012, by Imagination Technologies. Since then, the following processors have been introduced by Imagination Technologies.

The Warrior P-Class CPU was announced on 14 October 2013.[1]

The CPU IP cores comprising the MIPS Series5 ‘Warrior’ family are based on MIPS32 release 5 and MIPS64 release 6, and will come in three classes of performance and features:

  • 'Warrior M-class': entry-level MIPS cores for embedded and microcontroller applications, a progression from the popular microAptiv family
  • 'Warrior I-class': mid-range, feature-rich MIPS CPUs following on from the highly efficient interAptiv family. The I6400, with its 64-bit core, was launched September 2014.[2]
  • 'Warrior P-class': high-performance MIPS processors building on the proAptiv family
MIPS version level Processor Year Process (nm) Frequency (GHz) Transistors (billions) Die area (mm2) Pin count Power (W) Voltage (V) D. cache (KB) I. cache (KB) MMU L2 cache L3 cache Features
MIPS32 Release 5 Warrior-P P5600 2013 ? 1.0 to 2.0 ? ? ? ? ? 32/64 32/64 TLb Up to 8 MB external none VZ, MSA
Warrior-M M5100 2014 65/28 0.1 to 0.497 ? 0.04 to 0.77 ? none none FMT none none VZ
Warrior-M M5150 2014 65/28 0.372/0.576 ? 0.89/0.26 ? up to 64 up to 64 TLB none none VZ
MIPS64 Release 6 Warrior-P P6600 2015 28 Up to 2.0 ? ? ? ? ? 32/64 32/64 TLB 0.5 - 8 MB external none SMT, VZ
Warrior-I I6400 2014 28 1.0 ? 1/core ? ? ? 32/64 32/64 TLB 0.5 - 8 MB external none SMT, VZ
Warrior-M M6200 2015 65/40/28 up to 0.750 ? 0.19 ? none none FMT none none
Warrior-M M6250 2015 65/40/28 up to 0.750 ? 0.23 ? up to 64 up to 64 TLB none none XPA
MIPS version level Processor Year Process (nm) Frequency (GHz) Transistors (billions) Die area (mm2) Pin count Power (W) Voltage (V) D. cache (KB) I. cache (KB) MMU L2 cache L3 cache Features


龙芯中科

主条目：龙芯 §  芯片基本信息
系列 型號 頻率
（MHz） 		指令集架构
 微架構 推出年份 核心數目 製程
（nm） 		晶體管
（百万） 		裸晶面积
（mm²） 		功耗
（W） 		電壓
（V） 		缓存（KiB） 峰值浮点性能
（GFLOPS） 		备注
一级（单核） 二级 三级
数据 指令
Godson 1 266 MIPS-II 32-bit 不適用 2001 1 180 22 71.4 1.0 未知 8 8 不適用 不適用 0.6 [3][4]
FCR_SOC 266 MIPS-II 32-bit 不適用 2007 1 180 未知 未知 未知 未知 8 8 不適用 不適用 0.6 [5][6]
2B 250 MIPS-III 64-bit 不適用 2003 1 180 未知 未知 未知 未知 32 32 不適用 不適用 未知
2C 450 MIPS-III 64-bit 不適用 2004 1 180 13.5 41.5 未知 未知 64 64 不適用 不適用 未知
2E 1000 MIPS-III 64-bit GS464 (r1)（原型） 2006 1 90 47 36 7 1.2 64 64 512 不適用 未知
龍芯１ 1A 300 MIPS32 GS232 2010 1 130 22 71.4 1.0 未知 16 16 不適用 不適用 0.6 [7]
1B 266 MIPS32 GS232 2010 1 130 13.3 28 0.6 未知 8 8 不適用 不適用 未知 [8]
1C 300 MIPS32 GS232 2013 1 130 11.1 28.3 0.5 未知 16 16 不適用 不適用 未知 [9]
1C101 8 MIPS32 GS132R 2018 1 130 未知 未知 未知 未知 不適用 不適用 不適用 不適用 未知 [10]
1D 8 MIPS32 GS132 2014 1 130 1 6 3 × 10−5 未知 不適用 不適用 不適用 不適用 未知 [11]
龍芯２ 2F 1200 MIPS-III 64-bit GS464 (r1) 2007 1 90 51 43 5 1.2 64 64 512 不適用 3.2 [12]
2G 1000 MIPS64 GS464 (r2) 2012 1 65 未知 未知 未知 1.15 64 64 4096 不適用 未知 [13]
2GP 800 MIPS64 GS464 (r2) 2013 1 65 82 65.7 8 1.15 64 64 1024 不適用 3.2
2I
2H 1000 MIPS64 GS464 (r2) 2012 1 65 152 117 5 1.15 64 64 512 不適用 4
2J0800 800 MIPS64 GS464 (r2) 2013 1 65 未知 未知 8 1.1 64 64 1024 不適用 未知
2J1500 800 MIPS64 GS464E 2016 1 40 未知 未知 8 未知 64 64 1024 不適用 未知
2K1000 1000 MIPS64 Release 2

LoongISA1.0

GS264 2017 2 40 1900 79 5 1.1 32 32 256 × 2 1024 8 [14]
龍芯３ 3A1000 1000 MIPS64 Release 2 GS464 (r2) 2009 4 65 425 174.5 10 1.15 64 64 256 × 4 不適用 16 [15]
3B1000 1000 MIPS64 Release 2 GS464v 2010 4+4 65 ＞ 600 未知 20 1.15 64 64 128 × 8 不適用 128 [16]
3B1500 1200–1500 MIPS64 Release 2 GS464v 2012 4+4 32 1140 142.5 30（典型）
60（向量） 		1.15–1.35 64 64 128 × 8 8192 150
3A1500-I 800–1000 MIPS64 Release 2

LoongISA1.0

GS464E 2015 4 40 621 202.3 15 1.15–1.25 64 64 256 × 4 4096 16 [17]
3A2000
3B2000
3A3000 1500 MIPS64 Release 2

LoongISA1.0

GS464E 2016 4 28 ＞ 1200 155.78 30 1.15–1.25 64 64 256 × 4 8192 24 [18][19]
3B3000
3A4000 1800-2000 MIPS64 Release 5

LoongISA2.0

GS464V(GS464EV) 2019 4 28 ? ? 30@1.6GHz

40@1.8GHZ

50@2.0GHz

0.95-1.25 64 64 256 x 4 8192 128
3B4000

北京君正

Ingenic JZ4725

SoCs incorporating the XBurst microarchitecture:[20]

Model Launch Fab (nm) XBurst1 FPU GPU VPU Datasheet Package Notes
version Core clock (MHz) L1 Dcache
[kB] 		L1 Icache
[kB] 		L2 cache
[kB]
Jz4720 2005 180 MIPS32 rev1 240 16 16 N/A N/A N/A N/A Jz4720[永久失效連結]
Jz4725B 2005 160 360 Jz4725
Jz4730 2005 180 336 Jz4730[永久失效連結]
Jz4740 2007 180 MIPS32 rev1 + SIMD 360 Jz4740[永久失效連結] adds RMVB, MPEG-1/2/4 decoding capability up to D-1 resolution thanks to SIMD instruction set
Jz4750 2009 180 MIPS32 rev1 + SIMD2 360 480p Jz4750 adds TV encoder
Jz4755 2009 160 400 576P Jz4755 QFP176 second core is for video processing only
Jz4760 2010 130 600 yes Vivante GC200 720p JZ4760
JZ4760B		 BGA345 second core is for video processing only, IEEE754-complient FPU
Jz4770 2011 65 MIPS32 rev2 + SIMD2 1000 256 yes Vivante GC860[21] 1080p JZ4770 BGA379 1080p video decoding unit for h.264, VC-1 and VP8 (a secondary 500 MHz MIPS processor with SIMD extension)
Jz4775[22] 65 MIPS32 rev2 + SIMD2 1000 32 32 256 yes X2D Core 720p JZ4775 BGA314 720p video decoding unit for h.264, VC-1 and VP8 (a secondary 500 MHz MIPS processor with SIMD extension)
Jz4780 2012 40 Dual MIPS32 rev2 + SIMD2 1200[23] 32 each 32 each 512 yes PowerVR SGX 540 1080p JZ4780 BGA390 Dual core (SMP) XBurst CPU, 1080p video decoding unit for h.264, VC-1 and VP8 (a secondary 500 MHz MIPS processor with SIMD extension)


其他公司

A number of companies licensed the MIPS architecture and developed their own processors.

MIPS version Licensee Processor Features Year Process (nm) Frequency (MHz) Transistors (millions) Die size (mm2) Pin count Power (W) Voltage (V) D. cache (KB) I. cache (KB) MMU L2 cache L3 cache
MIPS III Sony Computer Entertainment + Toshiba Emotion Engine
MIPS32 Alchemy Semiconductor Au1
Broadcom BMIPS3000
BMIPS4000
BMIPS5000 1300
BCM53001 65 400 32 32
BCM1255
MIPS64 SiByte SB1
Broadcom BCM1125H 400-800 4w @ 400 MHz 32 32 yes 256 KB
BCM1255 Dual-core, DDR2, 4× Gigabit LAN 800-1200 13 W @ 1 GHz 32 32 yes 512 KB
Cavium Octeon: CN30xx, CN31xx, CN36xx, CN38xx 2006
Octeon Plus: CN5xxx 2007
Octeon II: CN6xxx 2009
Octeon III: CN7xxx 2012
NEC VR4305
VR4310
NXP Semiconductors ??
??
MIPS version Licensee Processor Features Year Process (nm) Frequency (MHz) Transistors (millions) Die size (mm2) Pin count Power (W) Voltage (V) D. cache (KB) I. cache (KB) MMU L2 cache L3 cache

另见

参考

  1. ^ Imagination reveals first MIPS ‘Warrior P-class’ CPU core. 2013-10-14 [2013-10-28]. （原始内容存档于2014-04-02）. 
  2. ^ MIPS reborn with 64-bit core launch. [2019-11-30]. （原始内容存档于2017-05-12）. 
  3. ^ 引用错误：没有为名为godson1-1的参考文献提供内容
  4. ^ 引用错误：没有为名为godson1-2的参考文献提供内容
  5. ^ 引用错误：没有为名为fcr_soc1的参考文献提供内容
  6. ^ 引用错误：没有为名为fcr_soc2的参考文献提供内容
  7. ^ 龙芯1A_龙芯官方网站-[龙芯官方网站]. loongson.cn. [2019-05-08]. （原始内容存档于2019-05-08）. 
  8. ^ 龙芯1B_龙芯官方网站-[龙芯官方网站]. loongson.cn. [2019-05-08]. （原始内容存档于2019-05-08）. 
  9. ^ 龙芯1C_龙芯官方网站-[龙芯官方网站]. loongson.cn. [2019-05-08]. （原始内容存档于2019-05-08）. 
  10. ^ 龙芯1C101_龙芯官方网站-[龙芯官方网站]. loongson.cn. [2019-05-08]. （原始内容存档于2019-05-08）. 
  11. ^ 龙芯1D_龙芯官方网站-[龙芯官方网站]. www.loongson.cn. [2019-05-08]. （原始内容存档于2019-05-08）. 
  12. ^ 龙芯2F_龙芯官方网站-[龙芯官方网站]. www.loongson.cn. [2019-05-08]. （原始内容存档于2019-05-08）. 
  13. ^ 龙芯2G用户手册 (PDF). （原始内容 (PDF)存档于2020-11-29）. 
  14. ^ 龙芯2K1000_龙芯官方网站-[龙芯官方网站]. www.loongson.cn. [2019-05-08]. （原始内容存档于2019-05-08）. 
  15. ^ 龙芯3A1000_龙芯官方网站-[龙芯官方网站]. www.loongson.cn. [2019-05-08]. （原始内容存档于2019-05-08）. 
  16. ^ 龙芯3B1000用户手册 (PDF). （原始内容 (PDF)存档于2020-11-29）. 
  17. ^ 龙芯3A2000/3B2000. [2019-11-30]. （原始内容存档于2016-10-15）. 
  18. ^ 龙芯3A3000处理器芯片流片成功. [2019-11-30]. （原始内容存档于2016-10-22）. 
  19. ^ 龙芯3A3000/3B3000. [2019-11-30]. （原始内容存档于2016-11-30）. 
  20. ^ Ingenic Xburst Products. [2019-11-30]. （原始内容存档于2011-09-04）. 
  21. ^ Archived copy. [2011-12-13]. （原始内容存档于2012-06-03）. 
  22. ^ Suspected to be called as JZ4774 sometime
  23. ^ JZ4780 Mobile Application Processor Data Sheet[失效連結]
Index: pl ar de en es fr it arz nl ja pt ceb sv uk vi war zh ru af ast az bg zh-min-nan bn be ca cs cy da et el eo eu fa gl ko hi hr id he ka la lv lt hu mk ms min no nn ce uz kk ro simple sk sl sr sh fi ta tt th tg azb tr ur zh-yue hy my ace als am an hyw ban bjn map-bms ba be-tarask bcl bpy bar bs br cv nv eml hif fo fy ga gd gu hak ha hsb io ig ilo ia ie os is jv kn ht ku ckb ky mrj lb lij li lmo mai mg ml zh-classical mr xmf mzn cdo mn nap new ne frr oc mhr or as pa pnb ps pms nds crh qu sa sah sco sq scn si sd szl su sw tl shn te bug vec vo wa wuu yi yo diq bat-smg zu lad kbd ang smn ab roa-rup frp arc gn av ay bh bi bo bxr cbk-zam co za dag ary se pdc dv dsb myv ext fur gv gag inh ki glk gan guw xal haw rw kbp pam csb kw km kv koi kg gom ks gcr lo lbe ltg lez nia ln jbo lg mt mi tw mwl mdf mnw nqo fj nah na nds-nl nrm nov om pi pag pap pfl pcd krc kaa ksh rm rue sm sat sc trv stq nso sn cu so srn kab roa-tara tet tpi to chr tum tk tyv udm ug vep fiu-vro vls wo xh zea ty ak bm ch ny ee ff got iu ik kl mad cr pih ami pwn pnt dz rmy rn sg st tn ss ti din chy ts kcg ve
Prefix: a b c d e f g h i j k l m n o p q r s t u v w x y z 0 1 2 3 4 5 6 7 8 9

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